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一个存在的世界
https://chipsandcheese.com/2024/09/15/discussing-amds-zen-5-at-hot-chips-2024/
1. 每个线程只能用一个 decode cluster,主要的考虑是乱序不好处理,需要跑很高的频率以及有 Op Cache 兜底,未来可能会加上
2. Op Cache 每个 entry 可以存更多信息,所以即使 entry 数比 Zen 4 少,实际对应的指令数可能更大
3. Fetch+Decode 和 Op Cache 可以同时工作,但没讲如何同时工作
4. 每个线程可以用到完整的 2 fetch pipeline,但是会卡在 decode 上
这下无懈可击了
Grand Ridge -> Intel
Granite Ridge -> AMD
Granite Rapids -> Intel
Grand Rapids -> Michigan
Forwarded from David's random thoughts
月光下的新探索:Lunar Lake CPU (Lion Cove / Skymont) 微架构测试 https://blog.hjc.im/lunar-lake-cpu-uarch-review.html
2024/12/19 02:50:44
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